Xilinx可编程逻辑器件设计与开发_百度百科
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Xilinx可编程逻辑器件设计与开发
《Xilinx可编程逻辑器件设计与开发》是2011 年5月人民邮电出版社出版的图书，作者是王春平、张晓华、赵翔。
Xilinx可编程逻辑器件设计与开发内容简介
《xilinx可编程逻辑器件设计与开发(基础篇)》介绍了xilinx主流fpga的结构与特点、xilinx fpga的开发流程及其常用相关开发工具(包括ip核生成器、fpga editor、rtl/architecture原理图查看器、chipscope、planahead等工具)的应用，还介绍了业界使用最广泛的仿真工具modelsim，最后介绍了xilinx的8位微控制器picoblaze。
《xilinx可编程逻辑器件设计与开发(基础篇)》配有1张光盘，其中收录了《xilinx可编程逻辑器件设计与开发(基础篇)》所涉及的参考资料、完整工程、源代码等。
《xilinx可编程逻辑器件设计与开发(基础篇)》可作为高等院校通信工程、电子工程、计算机、自动化、微电子与半导体等专业的参考书，也可作为硬件工程师、ic设计者的实用工具书。[1]
Xilinx可编程逻辑器件设计与开发目录
《xilinx可编程逻辑器件设计与开发(基础篇)》
第1章　spartan-3系列fpga　1
1.1　spartan-3 系列内部结构　2
1.1.1　可配置逻辑模块(clb)　2
1.1.2　时钟资源　7
1.1.3　数字时钟管理器(dcm)　10
1.1.4　bram(block ram)模块　13
1.1.5　嵌入式硬核乘法器　14
1.1.6　iob模块　15
1.2　spartan-3型fpga　18
1.3　spartan-3e型fpga　19
1.4　扩展spartan-3a型fpga　19
1.5　小结　21
第2章　spartan-6系列fpga　22
2.1　spartan-6系列内部模块　23
2.1.1　可配置逻辑模块(clb)　23
2.1.2　时钟资源　27
2.1.3　时钟管理器(cmt)　33
2.1.4　bram(block ram)模块　41
2.1.5　dsp模块xtremedsp　44
.2.1.6　selectio资源　47
2.1.7　mcb模块　56
2.1.8　gtp模块　56
2.1.9　pcie端点模块　57
2.2　spartan-6 lx/lxt型fpga　58
2.3　小结　58
第3章　virtex-4系列fpga　59
3.1　asmbl架构　60
3.2　virtex-4内部模块　61
3.2.1　可配置逻辑模块(clb)　61
3.2.2　时钟资源　66
3.2.3　数字时钟管理器(dcm)　70
3.2.4　相位匹配时钟分频器(pmcd)　71
3.2.5　bram(block ram)模块　72
3.2.6　dsp模块xtremedsp　74
3.2.7　selectio模块　78
3.2.8　rocketio模块　86
3.2.9　以太网(ethernet mac)模块　88
3.2.10　处理器核(powerpc405)　91
3.3　virtex-4 lx型fpga　92
3.4　virtex-4 sx型fpga　92
3.5　virtex-4 fx型fpga　93
3.6　小结　94
第4章　virtex-5系列fpga　95
4.1　virtex-5系列器件内部逻辑结构　97
4.1.1　可配置逻辑模块(clb)　97
4.1.2　时钟资源　102
4.1.3　select io技术　108
4.1.4　rocket i/o技术　114
4.1.5　嵌入式dsp模块　115
4.1.6　嵌入式pcie模块　117
4.1.7　嵌入式powerpc模块　118
4.2　virtex-5 lx　119
4.3　virtex-5 lxt　120
4.4　virtex-5 sxt　120
4.5　virtex-5 txt　121
4.6　virtex-5 fxt　122
4.7　小结　123
第5章　virtex-6系列fpga　124
5.1　virtex-6内部模块　125
5.1.1　可配置逻辑模块(clb)　125
5.1.2　时钟资源　130
5.1.3　混合模式时钟管理器(mmcm)　135
5.1.4　bram(block ram)模块　139
5.1.5　dsp模块xtremedsp　140
5.1.6　selectio模块　146
5.1.7　gtx模块　152
5.1.8　gth模块　155
5.1.9　以太网(ethernet mac)模块　155
5.1.10　pcie端点模块　158
5.2　virtex-6 lxt型fpga　158
5.3　virtex-6 sxt型fpga　159
5.4　virtex-6 hxt型fpga　159
5.5　小结　161
第6章　xilinx ise 11.x开发流程　162
6.1　设计输入　163
6.1.1　设计要求　163
6.1.2　认识ise软件界面　168
6.1.3　创建工程　169
6.2　添加约束　172
6.2.1　引脚约束　173
6.2.2　时序约束　176
6.3　xst综合　182
6.3.1　xst综合属性设置　182
6.3.2　xst综合流程　190
6.4　实现　192
6.4.1　翻译阶段　193
6.4.2　映射阶段　195
6.4.3　布局布线阶段　199
6.5　isim仿真　202
6.5.1　添加仿真文件　202
6.5.2　行为仿真　203
6.5.3　时序仿真　203
6.6　impact编程与配置　204
6.6.1　使用impact生成fpga配置文件　204
6.6.2　使用impact生成prom编程文件　204
6.6.3　使用impact配置/编程　207
6.7　小结　209
第7章　ise 11.x的辅助设计工具　210
7.1　ip核生成工具和结构化设计向导　210
7.1.1　用core generator建立一个工程　212
7.1.2　用core generator生成存储器　216
7.1.3　用core generator生成时钟管理单元　224
7.2　fpga底层编辑器(fpga editor)　241
7.2.1　认识fpga editor底层编辑器　242
7.2.2　fpga底层编辑器设计实例　245
7.3　rtl寄存器传输级原理图查看器　251
7.3.1　rtl寄存器传输级原理图查看器的使用　251
7.3.2　rtl寄存器传输级原理图查看器的使用技巧　256
7.4　technology门级原理图查看器　258
7.4.1　利用technology原理图查看器进行层次分析　258
7.4.2　利用technology原理图辅助时序分析　262
7.5　小结　265
第8章　编程与配置　266
8.1　xilinx fpga的配置模式　266
8.1.1　主动串行模式　267
8.1.2　被动串行模式　270
8.1.3　主动并行模式　271
8.1.4　被动并行模式　272
8.1.5　边界扫描模式　275
8.1.6　高级配置模式——spi　277
8.1.7　高级配置模式——bpi　281
8.1.8　高级配置模式——system ace　283
8.2　xilinx fpga器件的配置流程　283
8.3　xilinx fpga器件配置的硬件方案　285
8.4　xilinx器件的配置文件　287
8.5　impact软件简介　290
8.6　小结　296
第9章　chipscope pro调试设计　297
9.1　chipscope pro相关ip核　299
9.2　chipscope pro核生成器　302
9.2.1　icon属性　303
9.2.2　ila属性　304
9.2.3　vio属性　307
9.2.4　atc2属性　308
9.2.5　chipscope pro内核生成器应用实例　311
9.3　chipscope pro内核插入器　318
9.4　chipscope pro分析仪　328
9.5　利用fpga editor修改chipscope pro核信号连接　335
9.6　小结　336
第10章　planahead工具应用　337
10.1　planahead开发流程　337
10.2　planahead输入、输出文件　338
10.3　用planahead进行rtl代码开发与分析　340
10.4　应用planahead进行i/o规划　354
10.5　planahead与时序分析　363
10.6　应用planahead进行布局规划　368
10.7　planahead与chipscope　372
10.8　planahead导入导出功能　380
10.9　小结　380
第11章　第三方仿真工具modelsim　381
11.1　ise 11.x支持的仿真工具　382
11.2　modelsim仿真库的建立　382
11.3　认识modelsim常用窗口　387
11.4　modelsim功能仿真　394
11.4.1　基于verilog的功能仿真　394
11.4.2　基于vhdl的功能仿真　395
11.4.3　基本功能仿真流程　395
11.4.4　modelsim的项目管理　400
11.4.5　自定义仿真库　403
11.5　modelsim时序仿真　405
11.5.1　基于verilog的时序仿真　405
11.5.2　基于vhdl的时序仿真　406
11.5.3　基本时序仿真流程　407
11.5.4　sdf时序标注文件　409
11.6　modelsim波形编辑器与仿真　410
11.6.1　用波形编辑器创建激励的步骤　410
11.6.2　vcd文件　412
11.7　用命令行方式进行仿真　414
11.7.1　常用命令介绍　414
11.7.2　命令行仿真实例　416
11.7.3　modelsim中的do文件　416
11.8　ise与modelsim协同仿真　417
11.9　modelsim仿真存储器　420
11.10　vhdl/verilog混合仿真　425
11.11　仿真结果的存储　426
11.12　小结　428
第12章　picoblaze 8位微控制器　430
12.1　picoblaze特性　430
12.2　picoblaze硬件基本结构　431
12.2.1　picoblaze功能模块说明　431
12.2.2　picoblaze接口信号　432
12.2.3　picoblaze指令集　433
12.2.4　picoblaze中断　437
12.2.5　picoblaze scratchpad ram——暂存器　438
12.2.6　picoblaze输入/输出端口　440
12.2.7　picoblaze指令存储器配置方式　443
12.3　picoblaze性能　445
12.4　picoblaze在fpga设计中的应用　445
12.5　picoblaze开发工具　447
12.5.1　kcpsm3开发工具　447
12.5.2　mediatronix pblazide开发工具　448
12.6　picoblaze设计开发包　450
12.7　picoblaze设计实例　451
12.8　小结　458
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PLDFPGA新手入门
PLD/FPGA新手入T
PLD是可踢器件（Programable Logic Device）的Q，FPGA是F隹删涕T列（Field Programable Gate Array)的Q，烧叩墓δ芑鞠嗤皇F原理略有不同，所以我有r可以忽略@烧叩^e，yQ榭删踢器件或PLD/FPGA。
PLD是子OI域中最具活力和l展前途的一技g，它的影z毫不於70年代纹C的l明和使用。
PLD能做什N呢？可以毫不F的v，PLD能完成任何底制骷墓δ埽现粮咝阅CPU,下至蔚74路，都可以用PLDF。PLD 如同一白或是一堆e木，工程可以通^鹘y的原理D入法，或是硬件描述Z言自由的O一底窒到y。通^件仿真，我可以事先CO的正_性。 在PCB完成以後，可以利用PLD的在修改能力，Sr修改O而不必改佑布路。使用PLD黹_l底蛛路，可以大大s短Org，p少PCB面e，提高系y的可靠性。 PLD的@些c使得PLD技g在90年代以後得到w速的l展，同r也大大推恿EDA件和硬件描述Z言（HDL)的M步。
如何使用PLD呢？其PLD的使用很危WPLD比W纹C要蔚亩啵底蛛路基A，褂糜算C，就可以M行PLD的_l。_lPLD需要了解部分：1.PLD_l件； 2.PLD本身。
一、PLD_l件
由於PLD件已l展的相完善，用羯踔量梢圆挥迷了解PLD的炔拷Y，也可以用自己熟悉的方法：如原理D入或HDLZ言硗瓿上喈 秀的PLDO。所以ΤW者，首先私PLD_l件和_l流程。了解PLD的炔拷Y，⒂兄短岣呶O的效率和可靠性。
如何@得PLD_l件件呢? S多PLD公司都提供免M用版或演示版(然商I版大都是收M的），例如：可以免M 上下dAltera公司的 QuartusII （web版），或向其代理商索取@套件。Xilinx 公司也提供免M件：ISE WebPack,@套可以xilinxW站下d。Lattice提供isplever Base版下d，Actel等公司也都有似的免M件提供。以上免M件都需要在W上注陨暾License文件，如果您License的安b有不清楚，仔x相PW上的f明，也可以下d@篇文n：EDA件的license管理c安b。 通常@些免M件已能M足一般O的需要，然，要想件功能更大一些，只能I商I版件。
如果您打算使用VHDL或Verilog HDL硬件描述Z言黹_lPLD/FPGA,通常需要使用一些I的HDL_l件,@是因FPGAS商提供的件的HDLC合能力一般都不是很,需要其他件砼浜鲜褂,情r可以通^g[【常用_l件】@得等多信息. PLDa品，一般分椋夯冻朔e（Product-Term）技g，EEPROM（或Flash）工的中小PLD，以及基於查找表 （Look-Up table）技g，SRAM工的大PLD/FPGA。EEPROM工的PLD密度小，多用於5,000T以下的小ＴO，m合做}s的M合 ，如ga。SRAM工的PLD(FPGA)，密度高，|l器多，多用於10,000T以上的大ＴO，m合做}s的r序，如底中盘砗透鞣N算法。如希望M一步了解，g[【PLD/FPGAYc原理】。
二、PLD/FPGA的分和使用
在PLD/FPGA_l件中完成O以後，件a生一最K的涛募ㄈ .pof ）。如何⒕涛募PLD芯片中去呢？
1．痘冻朔e（Product-Term）技g，EEPROM(或 Flash)工的PLD（如Altera的MAX系列，Lattice的大部分a品，Xilinx的XC9500，Coolrunner系列)， S家提供
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Xilinx可编程逻辑器件设计与开发（基础篇）
《Xilinx可编程逻辑器件设计与开发（基础篇）》是2011年人民邮电出版社出版的图书，作者是王春平、张晓华、赵翔。
Xilinx可编程逻辑器件设计与开发（基础篇）内容简介
《xilinx可编程逻辑器件设计与开发(基础篇)》介绍了xilinx主流fpga的结构与特点、xilinx fpga的开发流程及其常用相关开发工具(包括ip核生成器、fpga editor、rtl/architecture原理图查看器、chipscope、planahead等工具)的应用，还介绍了业界使用最广泛的仿真工具modelsim，最后介绍了xilinx的8位微控制器picoblaze。
《xilinx可编程逻辑器件设计与开发(基础篇)》配有1张光盘，其中收录了《xilinx可编程逻辑器件设计与开发(基础篇)》所涉及的参考资料、完整工程、源代码等。
《xilinx可编程逻辑器件设计与开发(基础篇)》可作为高等院校通信工程、电子工程、计算机、自动化、微电子与半导体等专业的参考书，也可作为硬件工程师、ic设计者的实用工具书。
Xilinx可编程逻辑器件设计与开发（基础篇）目录
《xilinx可编程逻辑器件设计与开发(基础篇)》
第1章　spartan-3系列fpga　1
1.1　spartan-3 系列内部结构　2
1.1.1　可配置逻辑模块(clb)　2
1.1.2　时钟资源　7
1.1.3　数字时钟管理器(dcm)　10
1.1.4　bram(block ram)模块　13
1.1.5　嵌入式硬核乘法器　14
1.1.6　iob模块　15
1.2　spartan-3型fpga　18
1.3　spartan-3e型fpga　19
1.4　扩展spartan-3a型fpga　19
1.5　小结　21
第2章　spartan-6系列fpga　22
2.1　spartan-6系列内部模块　23
2.1.1　可配置逻辑模块(clb)　23
2.1.2　时钟资源　27
2.1.3　时钟管理器(cmt)　33
2.1.4　bram(block ram)模块　41
2.1.5　dsp模块xtremedsp　44
.2.1.6　selectio资源　47
2.1.7　mcb模块　56
2.1.8　gtp模块　56
2.1.9　pcie端点模块　57
2.2　spartan-6 lx/lxt型fpga　58
2.3　小结　58
第3章　virtex-4系列fpga　59
3.1　asmbl架构　60
3.2　virtex-4内部模块　61
3.2.1　可配置逻辑模块(clb)　61
3.2.2　时钟资源　66
3.2.3　数字时钟管理器(dcm)　70
3.2.4　相位匹配时钟分频器(pmcd)　71
3.2.5　bram(block ram)模块　72
3.2.6　dsp模块xtremedsp　74
3.2.7　selectio模块　78
3.2.8　rocketio模块　86
3.2.9　以太网(ethernet mac)模块　88
3.2.10　处理器核(powerpc405)　91
3.3　virtex-4 lx型fpga　92
3.4　virtex-4 sx型fpga　92
3.5　virtex-4 fx型fpga　93
3.6　小结　94
第4章　virtex-5系列fpga　95
4.1　virtex-5系列器件内部逻辑结构　97
4.1.1　可配置逻辑模块(clb)　97
4.1.2　时钟资源　102
4.1.3　select io技术　108
4.1.4　rocket i/o技术　114
4.1.5　嵌入式dsp模块　115
4.1.6　嵌入式pcie模块　117
4.1.7　嵌入式powerpc模块　118
4.2　virtex-5 lx　119
4.3　virtex-5 lxt　120
4.4　virtex-5 sxt　120
4.5　virtex-5 txt　121
4.6　virtex-5 fxt　122
4.7　小结　123
第5章　virtex-6系列fpga　124
5.1　virtex-6内部模块　125
5.1.1　可配置逻辑模块(clb)　125
5.1.2　时钟资源　130
5.1.3　混合模式时钟管理器(mmcm)　135
5.1.4　bram(block ram)模块　139
5.1.5　dsp模块xtremedsp　140
5.1.6　selectio模块　146
5.1.7　gtx模块　152
5.1.8　gth模块　155
5.1.9　以太网(ethernet mac)模块　155
5.1.10　pcie端点模块　158
5.2　virtex-6 lxt型fpga　158
5.3　virtex-6 sxt型fpga　159
5.4　virtex-6 hxt型fpga　159
5.5　小结　161
第6章　xilinx ise 11.x开发流程　162
6.1　设计输入　163
6.1.1　设计要求　163
6.1.2　认识ise软件界面　168
6.1.3　创建工程　169
6.2　添加约束　172
6.2.1　引脚约束　173
6.2.2　时序约束　176
6.3　xst综合　182
6.3.1　xst综合属性设置　182
6.3.2　xst综合流程　190
6.4　实现　192
6.4.1　翻译阶段　193
6.4.2　映射阶段　195
6.4.3　布局布线阶段　199
6.5　isim仿真　202
6.5.1　添加仿真文件　202
6.5.2　行为仿真　203
6.5.3　时序仿真　203
6.6　impact编程与配置　204
6.6.1　使用impact生成fpga配置文件　204
6.6.2　使用impact生成prom编程文件　204
6.6.3　使用impact配置/编程　207
6.7　小结　209
第7章　ise 11.x的辅助设计工具　210
7.1　ip核生成工具和结构化设计向导　210
7.1.1　用core generator建立一个工程　212
7.1.2　用core generator生成存储器　216
7.1.3　用core generator生成时钟管理单元　224
7.2　fpga底层编辑器(fpga editor)　241
7.2.1　认识fpga editor底层编辑器　242
7.2.2　fpga底层编辑器设计实例　245
7.3　rtl寄存器传输级原理图查看器　251
7.3.1　rtl寄存器传输级原理图查看器的使用　251
7.3.2　rtl寄存器传输级原理图查看器的使用技巧　256
7.4　technology门级原理图查看器　258
7.4.1　利用technology原理图查看器进行层次分析　258
7.4.2　利用technology原理图辅助时序分析　262
7.5　小结　265
第8章　编程与配置　266
8.1　xilinx fpga的配置模式　266
8.1.1　主动串行模式　267
8.1.2　被动串行模式　270
8.1.3　主动并行模式　271
8.1.4　被动并行模式　272
8.1.5　边界扫描模式　275
8.1.6　高级配置模式——spi　277
8.1.7　高级配置模式——bpi　281
8.1.8　高级配置模式——system ace　283
8.2　xilinx fpga器件的配置流程　283
8.3　xilinx fpga器件配置的硬件方案　285
8.4　xilinx器件的配置文件　287
8.5　impact软件简介　290
8.6　小结　296
第9章　chipscope pro调试设计　297
9.1　chipscope pro相关ip核　299
9.2　chipscope pro核生成器　302
9.2.1　icon属性　303
9.2.2　ila属性　304
9.2.3　vio属性　307
9.2.4　atc2属性　308
9.2.5　chipscope pro内核生成器应用实例　311
9.3　chipscope pro内核插入器　318
9.4　chipscope pro分析仪　328
9.5　利用fpga editor修改chipscope pro核信号连接　335
9.6　小结　336
第10章　planahead工具应用　337
10.1　planahead开发流程　337
10.2　planahead输入、输出文件　338
10.3　用planahead进行rtl代码开发与分析　340
10.4　应用planahead进行i/o规划　354
10.5　planahead与时序分析　363
10.6　应用planahead进行布局规划　368
10.7　planahead与chipscope　372
10.8　planahead导入导出功能　380
10.9　小结　380
第11章　第三方仿真工具modelsim　381
11.1　ise 11.x支持的仿真工具　382
11.2　modelsim仿真库的建立　382
11.3　认识modelsim常用窗口　387
11.4　modelsim功能仿真　394
11.4.1　基于verilog的功能仿真　394
11.4.2　基于vhdl的功能仿真　395
11.4.3　基本功能仿真流程　395
11.4.4　modelsim的项目管理　400
11.4.5　自定义仿真库　403
11.5　modelsim时序仿真　405
11.5.1　基于verilog的时序仿真　405
11.5.2　基于vhdl的时序仿真　406
11.5.3　基本时序仿真流程　407
11.5.4　sdf时序标注文件　409
11.6　modelsim波形编辑器与仿真　410
11.6.1　用波形编辑器创建激励的步骤　410
11.6.2　vcd文件　412
11.7　用命令行方式进行仿真　414
11.7.1　常用命令介绍　414
11.7.2　命令行仿真实例　416
11.7.3　modelsim中的do文件　416
11.8　ise与modelsim协同仿真　417
11.9　modelsim仿真存储器　420
11.10　vhdl/verilog混合仿真　425
11.11　仿真结果的存储　426
11.12　小结　428
第12章　picoblaze 8位微控制器　430
12.1　picoblaze特性　430
12.2　picoblaze硬件基本结构　431
12.2.1　picoblaze功能模块说明　431
12.2.2　picoblaze接口信号　432
12.2.3　picoblaze指令集　433
12.2.4　picoblaze中断　437
12.2.5　picoblaze scratchpad ram——暂存器　438
12.2.6　picoblaze输入/输出端口　440
12.2.7　picoblaze指令存储器配置方式　443
12.3　picoblaze性能　445
12.4　picoblaze在fpga设计中的应用　445
12.5　picoblaze开发工具　447
12.5.1　kcpsm3开发工具　447
12.5.2　mediatronix pblazide开发工具　448
12.6　picoblaze设计开发包　450
12.7　picoblaze设计实例　451
12.8　小结　458可编程逻辑器件的认识_百度文库
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